搞定ESD(九):静电放电之PCB设计

文章目录

  • 一、PCB叠层设计优化ESD性能
    • 1.1 PCB叠层设计对ESD性能影响机理分析
    • 1.2 PCB叠层设计优化改善ESD问题案例
  • 二、PCB布局设计优化ESD性能
    • 2.1 PCB布局静电放电案例(一)
    • 2.2 PCB布局静电放电案例(二)
  • 三、PCB布线设计优化ESD性能
    • 3.1 环路面积最小化设计
      • 3.1.1 芯片供电电源滤波环路面积最小化
      • 3.1.2 信号环路面积最小化
    • 3.2 降低参考地平面之间的电位差
      • 3.2.1 地分割产生电位差引发ESD问题

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