PCM5102A具有PLL和32位、384kHz PCM/I2S接口的2.1VRMS、112dB音频立体声DAC

PCM5102A外观和丝印

PCM5102A外观和丝印

1 特性

1•超低带外噪声
•具有BCK基准的高性能集成音频锁相环(PLL),可在内部生成SCK
•直接线路电平2.1VRMS输出
•无需隔直电容
•线路电平输出支持低至1kΩ的负载
•智能静音系统;软斜升或斜降搭配模拟静音,实现120dB静音信噪比(SNR)
•接收16、24和32位音频数据
•PCM数据样式:I2S,左对齐
•当LRCK和BCK被置为无效时,自动进入省电模式
•1.8V或3.3V故障安全低压CMOS(LVCMOS)数字输入
•采用硬件引脚的简易配置
•单电源供电:–3.3V模拟电源、1.8V或3.3V数字电源
•符合AEC-Q100标准

2 应用

•A/V接收器、DVD、BD播放器
•汽车信息娱乐系统和远程信息处理
•HDTV接收器
•汽车售后加装放大器

简化系统图

PCM5102A简化系统图

引脚定义

PCM5102A引脚定义

应用电路图

PCM5102A应用电路图

3 说 明

PCM5102A 器件属于单片 CMOS 集成电路系列,由立体声数模转换器 (DAC) 和采用薄型小外形尺寸(TSSOP) 封装的附加支持电路组成。PCM5102A 器件使用 TI 最新一代高级分段 DAC 架构产品,可实现出色的动态性能并提升针对时钟抖动的耐受度。

凭借 DirectPath™电荷泵技术,PCM5102A 器件提供2.1 V RMS 中央接地输出(设计人员无需在输出上连接隔直电容)以及传统意义上与单电源线路驱动器相关的外部静音电路。

集成线路驱动器的每个引脚支持低至 1kΩ 的负载,从而在性能上超过其他所有基于电荷泵的线路驱动器。

器件上集成的 PLL 免除了对于系统时钟(通常称为主时钟)的需要,从而实现一个 3 线制 I2S 连接并减少了系统电磁干扰 (EMI)。
智能时钟误差与 PowerSense 欠压保护采用双层系统,能够消除喀嗒和噼啪声。

相比许多传统的开关电容 DAC 架构,PCM5102A 系列能够将带外噪声控制在 20dB 的较低水平,从而减少下游放大器/ADC 中的 EMI 和混叠(在 100kHz(OBN典型值)到 3MHz 之间测得)。

表1. 器件信息 1

器件型号封装封装尺寸
PCM5102ATSSOP (20)5.50mm x 4.40mm

表2. 器件信息 2

零件编号动态范围SNRTHD
PCM5102A112dB112dB–93 dB

引脚功能

引脚名称引脚编号类型功能
AGND9模拟接地
AVDD8P模拟电源,3.3 V
BCK13I音频数据位时钟输入(1)
CAPM4O电荷泵飞跨电容器端子,用于负轨
CAPP2O电荷泵飞跨电容器端子,用于正轨
CPGND3电荷泵接地
CPVDD1P电荷泵电源,3.3 V
DEMP10I44.1 kHz 采样率的去加重控制 (1):关闭(低)/ 开(高)
DGND19数字接地
DIN14I音频数据输入(1)
DVDD20P数字电源,1.8 V 或 3.3 V
FLT11I滤波器选择 : 正常延迟 (低) / 低延迟 (高)
FMT16I音频格式选择 : I2S(低)/左对齐(高)
LDOO18P用于去耦的内部逻辑电源轨端子,或外部 1.8 V 电源端子
LRCK15I音频数据字时钟输入(1)
OUTL6O来自 DAC 左通道的模拟输出
OUTR7O来自 DAC 右通道的模拟输出
SCK12I系统时钟输入(1)
VNEG5O用于去耦的负电荷泵导轨端子,–3.3 V
XSMT17I软静音控制器,软静音 (低) / 软取消静音 (高)

9 详细说明

9.1 概述

所提供器件上的集成 PLL 增加了移除系统时钟(通常称为主时钟)的灵活性,允许 3 线 I2S 连接并降低系统 EMI。
Powersense 欠压保护采用两级静音系统。时钟错误或系统电源故障时,
该器件以数字方式衰减数据(或最后已知的良好数据),然后使模拟电路静音。
与现有的 DAC 技术相比,PCM510xA 器件的带外噪声降低了 20 dB。
降低下游放大器/ADC 中的 EMI 和混叠。(从传统的 100 kHz OBN 测量到 3 MHz)。
PCM510xA 器件接受 16 至 32 位数据的行业标准音频数据格式。支持高达 384 kHz 的采样率。

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