2024年数字IC秋招-海康威视-数字逻辑设计工程师-笔试题

文章目录

  • 前言
  • 一、多选题
    • 1、下面属于AXI定义的传输通道的是
    • 2、在SystemVerilog语言中,如果想要约束随机变量x在a和b之间,以下代码中正确的是?
    • 3、UVM的通信接口类型包括哪些?
    • 4、常见的代码覆盖率收集包括哪些?
    • 5、关于linux和windows操作系统的使用,以下说法正确的是?
    • 6、关于功能覆盖率,以下说法正确的是?
    • 7、关于shell脚本的语法,下面说法正确的是?
    • 8、以下关于定向测试说法错误的有?
  • 二、单选题
    • 1、sequence执行start程序时,会回调哪个函数?
    • 2、处理器中,开发存储器层次结构是基于什么原理
    • 3、以下属于代码检查工具的是?
    • 4、在python语法中,以下代码的输出是:
    • 5、在SystemVerilog语言中,函数Foo定义如下,那么执行其它代码完后,x和y的取值是多少?
    • 6、如果芯片的一个输入管脚在应用时没有连线,保持悬空。此时该信号经过PAD中的BUF到达内部逻辑电路时,观察到的该信号的值是什么
    • 7、以下哪个可以实现UVM callback机制?
    • 8、假设输入信号a, b, c的位宽分别是10bit,5bit,14bit,输出result=a*b+c,如果要实现不损失精度的输出,则输出需要定义为多少bit
    • 9、验证结束的衡量标准描述错误的是?
    • 10、在SystemVerilog语言中,x的y次方以下表达式正确的是?


前言

笔试题型:单选 + 多选
笔试平台:百一测试(电脑监控)
笔试时间:1h30min


一、多选题

1、下面属于AXI定义的传输通道的是

A. AW通道
B. D通道
C. B通道
D. AR通道


2、在SystemVerilog语言中,如果想要约束随机变量x在a和b之间,以下代码中正确的是?

A. a<=x<= b;
B. x <= b; x > = a;
C. b >=x; a<= X;
D. b>=X>=a


3、UVM的通信接口类型包括哪些?

A. port
B. fifo
C. export
D. imp


4、常见的代码覆盖率收集包括哪些?

A. 表达式覆盖(Condition Coverage)
B. 分支覆盖( Branch Coverage)
C. 状态机/翻专覆盖(FSM Coverage)
D. 语句覆盖(Statement Coverage)


5、关于linux和windows操作系统的使用,以下说法正确的是?

A. linux和windows下的工具安装包一般都是exe格式
B. linux 下的软件工具一般可以在cmd/GUI方式下运行
C. linux下更容易进行分组权限控制
D. linux下无法打开工具的GUI界面


6、关于功能覆盖率,以下说法正确的是?

A. 功能覆盖率达到100%,说明验证已经完备
B. 功能覆盖率仅针对transaction内A的变量才能收集
C. 可以通过功功能覆盖率检查激励是否正确覆盖模块某一功能
D. 功能覆盖率的收集可以通过DUT内部特定信号控制


7、关于shell脚本的语法,下面说法正确的是?

A. shell中可以调用类似sleep这样的操作系统函数
B. shell中可以使用if语句来实现条件判断
C. shel中可以定义函数
D. shell中支持for循环


8、以下关于定向测试说法错误的有?

A. 一般发生在验证早期阶段
B. 能有效缩短验证时间,驱动覆盖率快速达到100%
C. 能有效避免用例之间的覆盖率重复
D. 需要构造复杂的随机约束程序


二、单选题

1、sequence执行start程序时,会回调哪个函数?

A. print
B. start
C. body
D. phase


2、处理器中,开发存储器层次结构是基于什么原理

A. Amdahl定律
B. 数据级并行
C. 存储一致性
D. 局部性原理


3、以下属于代码检查工具的是?

A. Modelsim
B. Lint
C. DesignCompiler
D. vcs


4、在python语法中,以下代码的输出是:

x = list("the sky is blue")
y = x.index("s", 5,10)
print(y)

A. 5
B. 10
C. 4
D. 9


5、在SystemVerilog语言中,函数Foo定义如下,那么执行其它代码完后,x和y的取值是多少?

function int Foo (ref int x);return x++;
endfunction
x = 5;
y = Foo(x);

A. x=5, y=5
B. x=5,y=6
C. x=6,y=5
D. x=6,y=6


6、如果芯片的一个输入管脚在应用时没有连线,保持悬空。此时该信号经过PAD中的BUF到达内部逻辑电路时,观察到的该信号的值是什么

A. 1
B. 0或者1
C. 高阻态1’bz
D. 0


7、以下哪个可以实现UVM callback机制?

A. uvm_sequence
B. uvm_squence_item
C. uvm_tlm
D. uvm_driver


8、假设输入信号a, b, c的位宽分别是10bit,5bit,14bit,输出result=a*b+c,如果要实现不损失精度的输出,则输出需要定义为多少bit

A. 16
B. 24
C. 15
D. 29


9、验证结束的衡量标准描述错误的是?

A. RTL开发完成
B. 多轮随机测试完成
C. 覆盖率达到100%
D. 缺陷曲线收敛


10、在SystemVerilog语言中,x的y次方以下表达式正确的是?

A. x^y
B. x^^y
C. 其它选项均不正确
D. x%y


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