1.LVTTL：（3.3v）
2.LVCOMS：（1.8v）
3.LVDS（1.8v）：LVDS_25（2.5v）
4：如果是ddr3与fpga相连接fpga的vcco推荐（1.5v），电平 标准是SSTL15(HR/HP)
5:V7690t普通bank全是——HP
A7的bank33左右全是——HRbank，K7/V7的bank33左右全是——HPbank
6：
FPGA电平标准
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