嵌入式学习---ARM时钟体系

时钟相关概念

按一定电压幅度，一定时间间隔连续发出的脉冲信号。它是一个周期性的信号，每个周期内包含一个上升沿和一个下降沿。时钟脉冲的上升沿和下降沿通常用于触发和同步各个电子元件的操作，例如CPU的指令执行、数据传输、寄存器更新等。

时钟频率是指时钟脉冲的频率，即单位时间内时钟脉冲的数量。它通常以赫兹（Hz）为单位表示，表示每秒钟发生的时钟脉冲的次数。时钟频率决定了计算机系统的运行速度和性能，较高的时钟频率意味着更快的数据处理能力。

晶体振荡器（Crystal Oscillator）：晶体振荡器是使用晶体的谐振特性来产生稳定时钟信号的元件，与晶振类似，但通常包含更复杂的电路和调谐元件，可以提供更高的频率稳定性和精度。
MEMS振荡器（MEMS Oscillator）：MEMS振荡器是利用微机电系统（MEMS）技术制造的振荡器，通过微小的机械结构振动来产生时钟信号。它具有小尺寸、低功耗和抗震动等优点，适用于移动设备和嵌入式系统。
RC振荡器（RC Oscillator）：RC振荡器是使用电阻（R）和电容（C）构成的振荡电路，通过RC元件的充放电过程来产生时钟信号。它简单、成本低廉，但频率稳定性较差，适用于一些低要求的应用场景。
PLL锁相环（Phase-Locked Loop）：PLL是一种反馈控制系统，通过比较输入信号和参考信号的相位差，并调整输出信号的频率和相位，使其与参考信号同步。PLL可以提供稳定的时钟信号，并具有频率合成和时钟倍频等功能。
GPS接收器（GPS Receiver）：全球定位系统（GPS）接收器可以接收卫星发射的精确时间信号，并用作时钟参考。GPS接收器可以提供高精度的时钟信号，适用于需要高精度时间同步的应用，如通信基站和科学实验。
典型的系统时钟振荡器源通常采用石英晶振，而更复杂的系统时钟振荡器则是由PLL合成器提供。

在这里插入图片描述

S3C2440的主时钟晶振来自于外部晶振（XTIPLL）或者是外部时钟（EXTCLK）。时钟生成器包含了一个振荡器，其连接外部晶振，可以产生需要的高频，通过引脚OM[3：2]来决定时钟源是Crystal还是EXTCLK。

MPLL用于CPU及其他外围器件。通过MPLL会产生三个部分的时钟频率：FCLK【用于CPU核】、HCLK【用于AHB总线的设备】、PCLK【用于APB总线的设备】。
UPLL专用于USB设备。

在这里插入图片描述

上电几毫秒后，外部晶振输出稳定，FCLK=外部晶振频率（12MHz），nRESET信号恢复高电平后，CPU开始执行命令。
在设置MPLL的几个寄存器后，需要等待一段时间（Lock Time），MPLL的输出才稳定。在这段时间（Lock Time）内，FCLK停振，CPU停止工作。Lock Time的长短由寄存器LOCKTIME设定。
Lock Time之后，MPLL输出正常，CPU工作在新的FCLK（如400MHz）下。