对于频率比较小的时钟，使用clocking wizard IP往往不能产生，此时就需要我们使用代码进行自分频，自分频产生的时钟首先应该经过BUFG处理，然后还需要进行时钟约束，处理之后才能使用。
FPGA自分频产生的时钟如何使用？
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